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[新资讯] 泄露文档揭示了AMD Zen 3处理器架构的一些重要细节

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Lacy 发表于 2020-9-14 10:01:48 | 显示全部楼层 |阅读模式

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  上周,AMD 宣布了将于 10 月 8 日发布新一代 Zen 3 CPU、以及在 10 月 28 日介绍 RNDA 2 GPU 新品的公告。有趣的是,我们已经在一份开发者文档中知晓了有关 Zen 3 的关键细节。虽然泄露信息无法反映 Zen 3 的全貌,但这代仍有望带来相当强大的改进。

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  据悉,网友 @CyberPunkCat 在 Twitter 上泄露了这份机密文档,其中似乎有提及 Zen 3 相关的变动详情,我们或在 Ryzen 4000"Vermeer"系列桌面处理器上见到。

  仔细查看后,可知该文档似乎专为 AMD 19h 处理器家族的 Model 21h B0 处理器(即 Zen 3)提供了编程参考(PPR),此前我们也在 Zen+ 和 Zen 2 架构上见到过 17h 家族的各种型号和修订版本。

  需要指出的是,AMD 通常会在产品正式推出之后,才会向开发者提供相关文档,因而这份文档上泄露的内容或许还不够完整。

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  Zen 3 最显着的变化,或许体现在 CCD / CCX 模组的配置优化上。

  尽管沿用了多芯片模块(MCM / 又称小芯片)的设计、每两组搭配着一个 I/O 芯片,但 Zen 3 的每组 CCX 将合二为一、且支持单线程(1T)或同步多线程(SMT / 2T)的八核配置。

  换言之,Zen 3 将能够更加轻松地实现与 Ryzen 9 3950X 相同 16 核 / 32 线程。至于 AMD 最高会向 HEDT / 消费级桌面平台推出怎样的选项,仍有待时间去检验。

  此外,Zen 3 的缓存子系统也迎来了重大的设计变更 —— 一组 CCX 上的所有八个核心,将能够共享 32MB 的 L3 缓存。

  作为比较,Zen 2 上的两组 CCX 只能各自调用 16MB 的 L3 缓存。此外每个内核还有 512KB 的 L2 缓存,每组 CCD 总共有 4MB L2 缓存。

   7ba56cc232522b2.png


  有趣的是,AMD 还加强了可伸缩数据结构(SDF)。作为 Infinity Fabric(简称 IF)通信主干,其掌管着内核、内存控制器、以及其它 I/O 元素之间的数据传输和一致性。

  文档指出,Zen 3 的 SDF 现支持在每个 DRAM 通道上处理 512GB 的容量。此外可伸缩控制结构(SCF)也可能迎来一些小的更改,它是 Infinity Fabric 负责的另一半主要信令。

  值得一提的是,Zen 3 似乎正在通过两个统一的内存控制器(UMC)来拓展内存接口,让每个控制器支持一个 DRAM 通道、每个通道支持两个 DIMM 。

  辅以 Zen 2 时代就已支持的 DDR4-3200,看起来 Zen 3 将与 Zen 2 中的 Fusion Controller Hub(FCH)保持基本相同的功能和连接性。

  最后,除了历代保留的"一点点"时钟性能提升(主频和 IPC),Zen 3 似乎也将进一步完善 AMD 的 MCM 方案,重点在于改善延迟和一致性。
























原文链接:https://www.cnbeta.com/articles/tech/1028475.htm


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fudashuai 发表于 2020-9-14 16:19:20 | 显示全部楼层

活跃 13337| 技术 0| 互助 0| 钻石 0

泄露信息有所隐瞒啊~~~
yinbinly 发表于 2020-9-15 09:35:25 | 显示全部楼层

活跃 64490| 技术 30| 互助 53| 钻石 2266

理论上不会有太大变化 除非牙膏厂11代大变
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